应用于雷达干扰机的单比特测频算法研究和优化

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中文摘要：新体制雷达对抗技术的发展,对高宽带雷达信号的高速度、高灵敏度测频提出了日益迫切的需求.接收机是一种常用的雷达干扰机,其测频模块作为雷达对抗技术的一大核心模块,直接决定信号监测的覆盖带宽、信号处理的实时性以及灵敏度等方面.考虑到FPGA资源的稀缺性,设计旋转因子,得到改进的单比特测频算法,避免传统的离散傅里叶变换过于依赖大量乘法运算的不足.对0.2～2.2 GHz的随机频率正弦信号进行测试,未过度引入误差,且大幅优化了时间和空间复杂度.在新型RFSoC平台下编写Verilog代码进行实际测试和仿真优化,对比了基16到256的单比特测频性能.实验结果显示:权衡响应速度及灵敏度,基64的单比特测频最适合2 GHz带宽的雷达干扰技术需求,可以做到-50 dBm的灵敏度、18.75 MHz的最大频率精度误差;在低于100 ns的测频时间内,实现了对2.4 GHz的宽带信号的快速测频.

外文标题：Research and Optimization of Monobit Frequency Measurement Algorithm Applicable for Radar Jammer

作者：

张宇祥、黄明、杨杰、郭宇航、周元翰

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作者单位：

北方工业大学工学院,北京 100144

关键词：

雷达对抗技术干扰机 RFSoC平台单比特测频算法基64

出版年：

2023

DOI：

10.14103/j.issn.2095-8412.2023.04.011

工业技术创新

中国电子信息产业发展研究院和赛迪工业和信息化研究院（集团）有限公司

工业技术创新

ISSN：2095-8412

年,卷(期)：2023.10(2)

参考文献量9