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基于FPGA的高阶组合结构FIR数字滤波器设计

Design of high order mixed architecture FIR digital filter based on FPGA

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传统数字信号处理实验大都是基于Matlab软件的滤波器设计和仿真,为满足工程上实时性的要求,设计了一个以FPGA处理器为核心的FIR数字滤波器实验.为了兼顾运算速度和硬件资源消耗,采用8路并行乘加运算的组合结构,在FPGA平台上实现了511阶的高阶FIR带通滤波器.通过实验进一步研究了A/D采样位数不同时,滤波器系数量化位数对滤波性能和频率响应曲线精度的影响.实验结果表明,当输入模拟信号分别使用8bit和12bit采样时,滤波器系数量化位数分别取11位和13位,得到的幅频响应精度最高,硬件资源消耗最少.

蒋林、葛中芹、杨旭、姜乃卓、庄建军

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南京大学电子科学与工程学院,江苏南京210023

FPGA处理器 FIR滤波器 系数量化 幅频特性

2017年教育部第二批产学合作协同育人项目南京大学"十三五"实验教学改革研究重点课题南京大学"十三五"实验教学改革研究重点课题南京大学"十三五"实验教学改革研究重点课题

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2021

10.3969/j.issn.1672-4305.2021.03.018

实验室科学
南开大学　中国高等教育学会

实验室科学

影响因子：0.805
ISSN：1672-4305
年,卷(期)：2021.24(3)
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